数字验证工程师

1. 参与制定芯片或模块级的验证策略、方案与计划。 2. 使用 SystemVerilog 为模块及子系统级搭建可复用、自动化的验证平台。 3. 依据设计规格与架构文档，开发并执行定向或约束随机的测试，以达成全面的功能覆盖率。 4. 定义并分析功能覆盖率，跟踪代码覆盖率，确保验证的完备性。 5. 使用 Python、Perl 或 TCL 等脚本语言简化验证流程并提升回归测试效率。 6. 编写验证计划、验证报告及技术文档。 任职要求： 1. 精通高级验证语言，包括 SystemVerilog 与系统验证断言（SVA），具备使用 SystemVerilog 开发验证模型的实操经验。 2. 熟练使用 VCS、Xcelium、Verdi 等仿真与调试工具。 3. 深入理解数字芯片前端设计流程及整体验证过程。 4. 精通至少一种脚本语言（Python/Perl/TCL/Shell），并能开展脚本开…… 完整岗位描述与官方投递入口,请登录后在岗位详情页查看。

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