PCIE集成设计工程师(J10268)

1.IP集成：负责第三方PCIe控制器IP、PHY IP的选型、评估、配置与集成适配，保障IP与片上总线、外设模块无缝对接。 RTL开发：承担PCIe子系统相关RTL代码开发、模块集成与维护，完成Lint、CDC、时序分析、功耗评估等前端设计流程，解决功能、时序、跨时钟域问题。 2.PPA优化：主导PCIe子系统PPA优化（带宽/时延/抖动/功耗/面积），结合工艺节点完成性能权衡与迭代，满足量产指标。 3.验证协同：协同验证团队制定PCIe子系统验证方案与测试用例，配合仿真验证、FPGA原型验证，定位并修复设计问题。 4.后端配合：配合后端团队完成综合、时序收敛、布局布线，输出SDC时序约束、布局约束等文件。 5.调试测试：负责硅前调试、硅后bring-up与性能测试，联合软硬件团队定位量产与测试阶段的功能异常、性能瓶颈、兼容性问题，完成问题闭环。 6.经验沉淀：跟进PCIe协议标准更新，…… 完整岗位描述与官方投递入口,请登录后在岗位详情页查看。

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