DDR System Validation Engineer(J11723)

负责 SoC DDR 子系统的系统级测试与验证，包括 DDR3/DDR4/LPDDR4/LPDDR4X/LPDDR5/LPDDR5X 等存储器。 参与新 SoC 回片后的 DDR Bring-up，完成 DDR 基本功能、稳定性、性能及 Margin 测试，协助定位 Bring-up 阶段的 DDR 相关问题。 负责 DDR SI/PI 相关测试，包括 DQ/DQS/CLK/CA 等高速信号测量、Eye Diagram、Timing Margin、Voltage Margin、Power Rail 等测试和分析。 负责 DDR 颗粒及不同 Vendor/容量/频率组合的兼容性和 QPL 验证。 对测试过程中出现的 Fail 进行初步分析和定位，能够结合测试 Log、DDR Training 结果、寄存器信息、示波器/逻辑分析仪等工具分析问题，并协同 DDR FW、PHY、Controlle…… 完整岗位描述与官方投递入口,请登录后在岗位详情页查看。

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