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岗位描述（节选）
1. 负责串行器/解串器（SerDes）产品的架构定义与关键知识产权（IP）设计。
2. 参与 SerDes 产品的调试/验证、探针测试（CP）/成品测试（FT），确保一切顺利导向量产。
任职要求：
1. 电子工程硕士，5 年以上高速接口电路设计经验，如发送器/接收器/时钟数据恢复（CDR）。
2. 具备高速电路设计的实操技能。
3. 熟悉高速电路相关的版图知识。
4. 深入理解高速设计的一般理论，如抖动/信号完整性。
5. 良好的团队合作，自驱且有干劲。
6. 有 SerDes 架构定义与关键 IP 设计经验是重要加分项。
7. 有基于全双工链路的 SerDes 验证/调试及量产的完整经验是重要加分项。
8. 在以下方面具备实操经验者优先：1) 基于全双工串行链路的 SerDes 设计；2) 自适应连续时间线性均衡（CTLE）/判决反馈均衡（DFE）；3) 基于相位插值器（PI）的 C……
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