数字设计工程师(J14541)

- 根据内存或存储功能需求，编写微架构定义/撰写设计实现规范； - 编写模块或顶层RTL代码； - 进行IP级综合/时序分析/形式验证检查/CDC检查/代码覆盖率检查； - 协助验证工程师完成模块和顶层仿真与验证； - 在模块或顶层调试RTL/门级波形； - 对相关模块功能进行硅后调试，并相应提供ECO解决方案； 【任职要求】 - 电子电气工程学士或硕士； - 有内存或存储设计相关经验者优先； - 具备Verilog RTL编码、仿真调试以及基础或金属层ECO的技能； - 具有Cadence NC-Sim、Synopsys DC、PT等EDA工具的实际操作经验； - 具备脚本技能，熟悉TCL、Perl等； - 自我驱动，良好的团队合作精神和良好的沟通能力； - 有dram设计经验的优先

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